- 隨著通信系統的發展，要求通信具有更高的傳輸可靠性、更強的抗干擾能力。在無線信號發射過程中，射頻信號必須經功放放大，再經天線發射出去，信號經功放后的幅度和穩定性對通信的可靠性和抗干擾起著關鍵作用。攻放輸出信號的幅度越大通信可靠性越穩定，接收的準確性和可靠性就越高。在發射端，功放輸出功率控制一方面需要保證功放的安全可靠，另一方面又要盡可能使功放輸出功率最大。因此，對功放的輸出功率控制就顯得十分重要，早期的功放控制一般采用模擬等方法實現。
- 關鍵字：
C5509A DSP 功放 閉環 數字控制
- 紹了一種利用工具軟件MATLAB強大的數學功能來增強ALTERA公司的可編程邏輯器件設計軟件MAX+PLUSII的仿真功能、提高設計品質的方法，有較強的針對性。
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matlab 仿真 FPGA
- 雖然數碼相機 (DSC) 投入市場僅幾年時間，但已經使消費類電子成像業發生了翻天覆地的變化。目前，全球售出的相機中大約有三分之一是數碼相機，而且其份額還在穩步上升。
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DSP 數碼 MPEG-4 壓縮
- 你接到要求用FPGA實現FIR濾波器的任務時，也許會想起在學校里所學的FIR基礎知識，但是下一步該做什么呢?哪些參數是重要的?做這個設計的最佳方法是什么?還有這個設計應該怎樣在FPGA中實現?現在有大量的低成本IP核和工具來幫助你進行設計，因為FIR是用FPGA實現的最普通的功能。
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FIR濾波器 DSP LUT FPGA
- 對于實際的DSP應用系統特別是產品化的DSP系統而言，可靠性是一個不容忽視的問題。由于DSP系統的時鐘頻率比較高，因此在運行時極有可能發生干擾和被干擾的現象，嚴重時系統可能會出現死機。為了克服這種情況，除了在軟件上作一些保護措施外，硬件上也必須作相應的處理。硬件上最有效的保護措施就是采用具有監視(Watchdog)功能的自動復位電路。各大公司生產了多種微處理器監控器，用來監測微處理器的運行狀態，一旦微處理器失控就強行復位微處理器，引導程序重新運行。
- 關鍵字：
MAX706S DSP 監控電路
- 在衛星姿態和軌道控制計算機(AOCC)分系統的設計和室內聯調階段，為方便系統調試，需設計動量輪模擬器，模擬執行機構動量輪所決定的衛星姿態和控制效果，代替真實部件進行分系統的開環和閉環試驗。
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動量輪 模擬器 DSP
- 目前基于銅電纜的高速串口能夠以數千兆位速率進行數據傳送，并可通過使用多個并行通道達成超過100Gbps的數據傳輸率，不過傳送的距離卻受到限制，一個可以改善傳輸距離的作法是使用光互連來取代銅電纜，Alt
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DSP LGA FPGA DDM
- 為實現智能車全景視覺系統的應用研究平臺，設計了一種基于FPGA+雙DSP的實時6通道數字圖像采集與處理系統。該系統由兩片FPGA與兩個DSP組成。第一個FPGA進行多通道視覺圖像采集的同步控制、邏輯處理，第二片FPGA輔助DSP進行海量圖像數據的高速并行處理。
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全景視覺系統 FPGA+DSP 數字圖像采集與處理系統
- 針對高速視覺測量系統數據處理速度快、數據處理量大的特點，將FPGA技術與DSP技術相結合，研究了一種基于FPGA和多DSP的多通道并行處理的高速視覺測量系統。詳細介紹了FPGA技術與多DSP技術在數字圖像處理過程中的不同應用、高速視覺測量系統的總體結構以及各部分的工作原理。
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高速視覺測量系統 DSP FPGA
- 針對嵌入式導航計算機系統中CPLD器件軟件更新需求，提出了通過串行方式基于DSP的CPLD軟件更新方案，通過DSP的I／O口模擬CPLD的JTAG時序邏輯，將由串口接收到的CPLD配置信息文件，移入到其內部邏輯中，從而實現軟件更新。分析研究了實現該方案需解決的硬件和軟件中的關鍵問題，設計實現了提出的CPLD器件軟件更新方案，并在實際的導航計算機系統中進行了驗證和應用。
- 關鍵字：
CPLD器件軟件更新 DSP JTAG
- 在FPGA+DSP系統設計系統中，FPGA經常作為DSP的協處理器來輔助完成一些計算任務。而這些計算工作中最消耗時間的就是乘法運算，因此本實例的主要內容就是幫助讀者學會調用硬件乘法IP核。
- 關鍵字：
DSP 協同處理 FPGA 硬件乘法器
- 以上的接口中，比較常用的接口是EMIF和HPI。其中總線接口需要協議支持，開發難度較大，串行接口開發簡單，但是速率較慢。VPORT等特殊接口一般是在特定的場合下應用，不具備通用性，而且需要修改DSP驅動，開發周期較長。
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DSP 協同處理 FPGA 通信接口 EMIF HPI BlockRAM
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