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Arteris推出下一代FlexNoC 5物理感知片上網(wǎng)絡IP

  • 亮點: ●? ?第五代片上網(wǎng)絡互連硅IP技術●? ?與手動物理迭代相比，物理收斂速度快5倍●? ?使客戶能夠在時間進度和預算限制內實現(xiàn)PPA目標致力于加速片上系統(tǒng)（SoC）創(chuàng)建的領先系統(tǒng) IP 提供商Arteris,?Inc.（納斯達克股票代碼：AIP）今天宣布，推出 Arteris FlexNoC 5 物理感知片上網(wǎng)絡（NoC）互連 IP。FlexNoC 5 使 SoC 架構團隊、邏輯設計人員和集成商能夠整合跨功耗、性能和面積（PPA
  • 關鍵字： Arteris  FlexNoC 5  物理感知片上網(wǎng)絡  IP  

倍捷連接器收購IP&E供應商Testco Inc.

  • 倍捷連接器（PEI-Genesis）總裁兼首席執(zhí)行官Steven Fisher正式宣布收購有40年歷史，總部位于加州的連接、被動、和機電元器件（IP&E）供應商Testco Inc.,。Steven Fisher表示：“此次收購將為客戶提供更廣泛的IP&E產品方案。我們是行業(yè)值得信賴的互連專家，本次收購有助于提升我們解決互連問題的能力，更豐富的產品和服務，會進一步加強我們和客戶的合作。”40年以來，Testco?Inc.?為全球科技公司提供連接、被動、和機電元器件（IP
  • 關鍵字： 倍捷連接器  IP&E  Testco  

芯來科技：立足開源架構，做好RISC-V生態(tài)圈

  • 過去幾年，國際形勢的變化讓壯大中國芯片設計產業(yè)成為中國半導體產業(yè)發(fā)展的主題，伴隨著全社會對中國半導體產業(yè)的關注提升和資本的涌入，整個半導體設計產業(yè)鏈迎來全面的發(fā)展機遇。對中國集成電路設計產業(yè)來說，芯片設計能力的提升，不僅需要設計公司技術的提升，還需要先進的本土芯片制造能力和相關設計工具的鼎力支撐。  隨著國內芯片設計企業(yè)的大量涌現(xiàn)，本土芯片設計帶動著設計IP需求增長非常明顯，這不僅給成立多年的本土IP企業(yè)發(fā)展的黃金機遇，同時也催生出大量的新興IP初創(chuàng)企業(yè)，這些企業(yè)的起點高、IP運作經驗豐富，共同
  • 關鍵字： 芯來科技  RISC-V  IP  ICCAD  

奎芯科技：致力于打通Chiplet設計到封裝全鏈條

  • 過去幾年，國際形勢的變化讓壯大中國芯片設計產業(yè)成為中國半導體產業(yè)發(fā)展的主題，伴隨著全社會對中國半導體產業(yè)的關注提升和資本的涌入，整個半導體設計產業(yè)鏈迎來全面的發(fā)展機遇。對中國集成電路設計產業(yè)來說，芯片設計能力的提升，不僅需要設計公司技術的提升，還需要先進的本土芯片制造能力和相關設計工具的鼎力支撐。 隨著國內芯片設計企業(yè)的大量涌現(xiàn)，本土芯片設計帶動著設計IP需求增長非常明顯，這不僅給成立多年的本土IP企業(yè)發(fā)展的黃金機遇，同時也催生出大量的新興IP初創(chuàng)企業(yè)，這些企業(yè)的起點高、IP運作經驗豐富，共同為
  • 關鍵字： 奎芯科技  Chiplet  IP  ICCAD  

Codasip 宣布成立 Codasip 實驗室，以加速行業(yè)前沿技術的開發(fā)和應用！

  • 德國慕尼黑，2022年12月7日——處理器設計自動化和RISC-V處理器IP的領導者Codasip今日宣布成立Codasip實驗室（Codasip Labs）。作為公司內部創(chuàng)新中心，新的Codasip實驗室將支持關鍵應用領域中創(chuàng)新技術的開發(fā)和商業(yè)應用，覆蓋了安全、功能安全（FuSa）和人工智能/機器學習（AI/ML）等方向。該實驗室的使命在于識別和構建相關技術，以擴展定制計算的可能性，并加快具有定制化的、領域專用設計的差異化產品的開發(fā)，并縮短其上市時間。Codasip實驗室將由公司創(chuàng)始人兼總裁馬克仁（Ka
  • 關鍵字： Codasip  Codasip 實驗室  IP  RISC-V  

“倒金字塔”折射IP巨大價值，Imagination IP創(chuàng)新蝶變賦能半導體產業(yè)

  • 過去50余年，芯片制程迭代沿著摩爾定律滾滾向前，并持續(xù)增強著芯片的算力與性能。現(xiàn)如今，無論是在SoC上集成越來越多的功能模塊，又或是利用chiplet技術在先進制程下進一步提升芯片集成度，都充分展現(xiàn)了芯片性能、功耗和成本的改進不能僅僅依賴于制程的升級，而需從不同的維度拓展創(chuàng)新來延續(xù)摩爾定律的“經濟效益”。這導致芯片設計變得越來越困難，IP的作用也愈加凸顯，逐漸成為企業(yè)尋求設計差異化道路上的“秘鑰”。?日前，在深圳舉辦的第10屆EEVIA年度中國硬科技媒體論壇暨產業(yè)鏈研創(chuàng)趨勢展望研討會上，Imag
  • 關鍵字： IP  Imagination  

Imagination：SoC IP技術賦能未來硬核科技創(chuàng)新

  • 在龐大的半導體細分產業(yè)鏈中，IP是其中最特殊的一環(huán)。正是借助眾多的IP，才讓半導體發(fā)展的步伐如此之快。IP是整個半導體上游產業(yè)鏈里面的核心，根據(jù)統(tǒng)計數(shù)據(jù)可以發(fā)現(xiàn)，每一元芯片能撐起200多元的社會經濟，而每一元的IP，能支持20000元的社會經濟價值，所以IP公司的存在是必要的。 隨著芯片復雜度不斷提升，特別是芯片進入SoC時代使得系統(tǒng)對各個環(huán)節(jié)技術要求越來越高，對一些中小型公司、創(chuàng)業(yè)公司來說，他們需要在成長過程中專注核心領域，沒辦法提供整個SoC完整的技術，所以它需要IP公司的支持，IP公司能協(xié)
  • 關鍵字： Imagination  SoC  IP  GPU  

燦芯半導體提供MIPI IP完整解決方案

  • 中國上海—2022年10月14日——一站式定制芯片及IP供應商——燦芯半導體日前宣布推出可用于客制化ASIC/SoC設計服務的MIPI IP完整解決方案。該解決方案由一系列 MIPI控制器和PHY構成。可以幫助系統(tǒng)制造商和IC公司等設計高質量的ASIC/SoC產品，同時加速上市時間。 MIPI聯(lián)盟在2003年成立，MIPI全稱Mobile Industry Processor Interface，即移動產業(yè)處理器接口。顧名思義，是為了統(tǒng)一和簡化手機處理器的接口，CSI、DSI、DigRF、C/D
  • 關鍵字： 燦芯  MIPI IP  

Achronix收購FPGA網(wǎng)絡解決方案領導者Accolade Technology的關鍵IP和專長

  • 加利福尼亞州圣克拉拉市，2022年9月19日——高性能現(xiàn)場可編程邏輯門陣列（FPGA）和嵌入式FPGA（eFPGA）半導體知識產權（IP）領域的領導性企業(yè)Achronix半導體公司宣布：該公司已經收購了Accolade Technology的關鍵IP資產以及Accolade的技術團隊，此舉使Achronix的客戶能夠更快速且更輕松地設計高性能網(wǎng)絡和數(shù)據(jù)中心系統(tǒng)。Accolade在FPGA的網(wǎng)絡應用方面擁有深厚的專業(yè)知識，此次收購使Achronix能夠為開發(fā)網(wǎng)絡技術的客戶提供強大的硬件和軟件解決方案。“如今
  • 關鍵字： Achronix  FPGA  Accolade  IP  

燦芯半導體推出USB IP完整解決方案

  • 一站式定制芯片及IP供應商——燦芯半導體日前宣布推出可用于ASIC/SoC的USB IP完整解決方案。該解決方案由一系列 USB 控制器和 PHY 構成，可以助力系統(tǒng)制造商、個人電腦原始設備制造商和 IC公司等設計高質量的ASIC/SoC 產品。USB（通用串行總線）已經非常成功地將打印機、掃描儀、鍵盤、鼠標、閃存驅動器、操縱桿、相機和顯示器等硬件連接到各種計算機，包括智能手機、臺式機、平板電腦和筆記本電腦等。USB4規(guī)范在2019年9月由USB-IF組織執(zhí)行，可支持USB3、Displayport、PC
  • 關鍵字： 燦芯  USB IP  

第 150 億顆CEVA 助力芯片出貨

  • 全球領先的無線連接和智能感知技術及共創(chuàng)解決方案的授權許可廠商CEVA, Inc.(納斯達克股票代碼：CEVA)宣布，包含CEVA IP的并支付權利金的芯片的累計出貨量已經在第二季超過了150億顆。在上市將近二十周年之際，CEVA達成了這一重要里程碑。實現(xiàn)前100億顆CEVA助力的芯片出貨花費了超過15年時間，而完成隨后50 億顆芯片出貨則只用了不到三年半。 CEVA IP在物聯(lián)網(wǎng)時代以令人驚訝的速度被廣泛采用也證實了CEVA在無線連接的普及方面發(fā)揮了重要的作用。CEVA將5G、蜂窩物聯(lián)網(wǎng)、藍牙、
  • 關鍵字： CEVA  IP  

Credo正式推出基于臺積電5nm及4nm先進制程工藝的全系列112G SerDes IP產品

  • ?Credo Technology（納斯達克股票代碼：CRDO）近日正式宣布推出其基于臺積電5nm及4nm制程工藝的112G PAM4 SerDes IP全系列產品，該系列能夠全面覆蓋客戶在高性能計算、交換芯片、人工智能、機器學習、安全及光通信等領域的廣泛需求，包括：超長距（LR+）、長距（LR）、中距（MR）、超極短距（XSR+）以及極短距（XSR）。?Credo IP產品業(yè)務開發(fā)助理副總裁Jim Bartenslager表示， “Credo先進的混合信號以及數(shù)字信號處理（DSP）1
  • 關鍵字： Credo  臺積電  5nm  4nm  SerDes  IP  

嵌入式北斗網(wǎng)絡時間服務器的Web網(wǎng)頁實現(xiàn)

  • 摘要：本文介紹了嵌入式北斗網(wǎng)絡時間服務器的基本功能，重點講述了如何在該設備中添加Web網(wǎng)頁的方法 及實現(xiàn)過程，以及在嵌入式設備中添加此功能應該考慮的資源因素。關鍵詞：TCP/IP；HTTP；Cortex-M4；RAM；鏈表?1 時間服務器功能描述北斗衛(wèi)星接收終端接收北斗導航衛(wèi)星發(fā)射的 RNSS （Radio Navigation Satellite System，無線導航衛(wèi)星系統(tǒng)） 無線電波信號，在設備內部通過 PVT 解算，計算出用 戶當前的位置、速度以及時間信息。北斗的時間信息具
  • 關鍵字： 202208  TCP/IP  HTTP  Cortex-M4  RAM  鏈表  

Inuitive 與 Arteris IP 合作為邊緣設備 提供下一代視覺處理技術

  • Inuitive? 和業(yè)界領先的提供片上網(wǎng)絡(NoC)互連和IP部署軟件以加快系統(tǒng)級芯片(SoC)創(chuàng)建的系統(tǒng)IP供應商 Arteris? Inc.今天宣布，Inuitive 已為其下一代計算機視覺平臺部署了 Arteris FlexNoC? 互連 IP。該技術解決了連接和時序收斂的挑戰(zhàn)，可以實現(xiàn)先進的下一代前沿視覺處理器所需的激進性能目標。這些先進的 SoC 將擴展多核視覺處理并增強高質量的深度傳感。這些芯片將部署在 3D 深度成像、物體識別和跟蹤，以及其他使用計算機視覺算法的各種應用中，比如增強現(xiàn)實、虛
  • 關鍵字： Arteris  IP  視覺處理器  

燦芯半導體推出兩項創(chuàng)新技術用于DDR物理層

  • 一站式定制芯片及IP供應商——燦芯半導體日前宣布推出用于高速DDR物理層中的Zero-Latency （零延遲）和True-Adaptive（真自適應）兩項技術。這兩項技術已經開始在12/14 FinFET, 22/28nm的DDR4/LPDDR4,4x高性能物理層IP上進行部署，將為客戶帶來更高效、更穩(wěn)定的全新體驗。 Zero-Latency （零延遲） 技術在讀數(shù)據(jù)通路上，采用了兩種可選的、獨特的采樣方式進行數(shù)據(jù)轉換，而不像其他DDR物理層供貨商采用FIFO進行跨時鐘域轉換，此技術將延遲降低
  • 關鍵字： 燦芯  DDR  IP  
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ip your way介紹

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