- IT之家 9 月 12 日消息,聯發科天璣 9400 旗艦手機處理器將于今年 10 月亮相,根據目前已知爆料信息,vivo X200 系列手機將首發天璣 9400 處理器,而 OPPO Find X8 / Pro 手機同樣搭載天璣 9400 處理器。而高通驍龍 8 Gen 4 也將在今年 10 月的驍龍峰會 2024 推出,盧偉冰則宣布小米即將首發旗艦新平臺,預計就是驍龍 8 Gen 4。今日,博主 @數碼閑聊站 曬出了兩款處理器的具體參數信息,IT之家為大家匯總對
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天璣 驍龍 SoC
- IT之家 9 月 11 日消息,蘋果 iPhone 16 系列手機已于昨日凌晨發布,升級 A18 / Pro 芯片。IT之家今天早些時候曾報道 iPhone 16 Pro 系列的 GeekBench 跑分,A18 Pro 的表現并不理想,但最新的跑分已經出爐,這次跑分似乎更為正常一些。目前,代號 iPhone 17,2 的 iPhone 16 Pro 系列機型 GeekBench 最新跑分已出爐。其單核成績高達 3409 分,
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iPhone 16 A18 SoC
- IT之家 9 月 7 日消息,新一代蘋果 iPhone 16 系列將于下周二正式發布。英國《金融時報》稱,蘋果將在發布會上發布 A18 芯片,采用軟銀旗下 Arm 公司最新的 V9 架構,力推 AI 功能進入手機。目前,Arm 擁有著世界上大多數智能手機芯片架構背后的知識產權,該公司則主要是將其授權給其他公司進行獲取收益。蘋果 iPhone、iPad 和 Mac 所搭載的定制芯片均使用了 Arm 的技術。參考IT之家此前報道,蘋果去年 9 月與 Arm 簽署了一項“
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iPhone 16 AI A18 SoC
- 西門子數字化工業軟件近日宣布 SiliconAuto 已采用西門子 PAVE360? 軟件,助其縮短汽車半導體產品系列的開發時間,在芯片推出之前為其潛在客戶提供軟件開發環境,以實現開發流程前置。SiliconAuto成立于2023年,是鴻海科技集團(Hon Hai Technology Group,富士康)與Stellantis集團合資成立的車用芯片設計公司,致力于設計和銷售先進的車用半導體產品,為汽車行業打造全方位車用芯片解決方案。SiliconAuto 的目標是希望在芯片推出之前為客戶提供虛擬參考平臺
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SiliconAuto 西門子 PAVE360 ADAS SoC
- IT之家 8 月 27 日消息,消息源 Yogesh Brar 昨日(8 月 26 日)發布博文,分享了小米定制手機芯片的細節,稱該芯片采用臺積電的 N4P(第二代 4nm)工藝,性能跑分處于高通驍龍 8 Gen 1 級別。消息源還透露該芯片采用紫光展銳(Unisoc)的 5G 基帶,預估將會在 2025 年上半年亮相。這已經不是我們第一次聽說小米有可能開發新的智能手機芯片了,IT之家曾于今年 2 月報道,小米正與 ARM 合作打造自研 AP(即應用處理器,基本等同移動設備 SoC)。
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小米 SoC 臺積電
- 談及嵌入式設備,安全性一直是人們關注的一大話題。然而目前為止,人們的注意力都放在了錯誤的方向上。不安全的網絡邊緣計算和物聯網設備已經證明,最薄弱(且經常被忽視)的環節往往導致重大的安全漏洞。慶幸的是,設計師現在可以采用一些重要的新方案確保將硬件可信根、集成加密、固件彈性等關鍵功能融入到各種互連設備的設計中。秘訣是什么?FPGA。具體而言,全新低功耗FPGA解決方案,如萊迪思MachXO5D-NX?系列芯片,搭配萊迪思Propel?和萊迪思Sentry?軟件解決方案,可以幫助設備和系統設計人員以經濟高效、低
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FPGA 嵌入式設備安全 萊迪思
- 本系列文章從數字芯片設計項目技術總監的角度出發,介紹了如何將芯片的產品定義與設計和驗證規劃進行結合,詳細講述了在FPGA上使用IP核來開發ASIC原型項目時,必須認真考慮的一些問題。文章從介紹使用預先定制功能即IP核的必要性開始,通過闡述開發ASIC原型設計時需要考慮到的IP核相關因素,用八個重要主題詳細分享了利用ASIC IP來在FPGA上開發原型驗證系統設計時需要考量的因素。在上篇文章中,我們分享了第二到第四主題,介紹了使用FPGA進行原型設計時需要立即想到哪些基本概念、在將專為ASIC技術而設計的I
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ASIC IP FPGA SmartDV
- 《科創板日報》19日訊,科技記者古爾曼在最新一期Power
On時事通訊中透露,蘋果公司并未放棄開發自有蜂窩調制解調器技術,該公司計劃繼續花費數十億美元和數百萬小時的工作時間來開發相關芯片。古爾曼同時表示,蘋果正計劃開發一種“更加統一”的芯片,該芯片據稱將現款SoC的基礎上整合入蜂窩硬件功能,但目前關于相關芯片的更多信息還不得而知。
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古爾曼 蘋果 蜂窩調制解調器 芯片 SoC
- XMOS推出的基于其第三代xcore架構的xcore.ai系列可編程SoC芯片,在一顆器件里面集成了邊緣AI、DSP、控制單元和I/O等功能,因而可以針對應用利用軟件將其定義為不同的器件系統,在保持靈活性和可編程性的同時提供優異的性能,從而可以有更快的速度和更低的成本完成全新器件系統的開發。本文將介紹如何利用xcore.ai芯片開發DSP系統,并以XMOS與DSP Concepts近期宣布的合作協議為例,展示音頻開發人員如何將 XMOS 的高度確定性、低延遲的 xcore.ai 平臺與 DSP Conce
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DSP 軟件定義 SoC 音頻汽車
- 引言隨著嵌入式系統的不斷發展,設計師面臨著越來越多的挑戰。功能性和連接性增加了集成的復雜性,尤其是在設計系統級芯片(SoC)時,通常很難提供最佳的邏輯架構來管理系統。本文將探討嵌入式FPGA(eFPGA)的結構,并探討如何在保持最大靈活性的同時,實現硅資源的最佳優化。高級SoC設計取代板級系統我們正進入一個將許多傳統PCB上的IC合并到單一單片IC或芯片組作為SoC的時代。如果IC設計團隊未能加入正確的功能,或者在設計部分發現了漏洞,他們可能會錯失市場機會或時間節點。傳統上,FPGA常用于原型設計、在PC
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FPGA
- 現場可編程門陣列(FPGA)在當今的眾多技術中發揮著重要作用。從航空航天和國防到消費電子產品,再到關鍵基礎設施和汽車行業,FPGA在我們生活中不斷普及。與此同時對FPGA器件的威脅也在不斷增長。想要開發在FPGA上運行(固件)的IP需要花費大量資源,受這些FPGA保護的技術也是如此。這使得FPGA成為IP盜竊或破壞的潛在目標。防止IP盜竊、客戶數據泄露和系統整體完整性所需的安全功能已經不可或缺。它們是許多FPGA應用的基礎,在某些地區有相應法律要求(例如,歐盟的GDPR、美國的HIPAA、英國的2018年
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萊迪思 Avant-X FPGA
- 設計需求:硬十開發的一塊基于安路EG4X20BG256的FPGA板卡。該系統應用于一個USB傳輸,可以進行多通道ADC數據采集的項目。整體框圖如下:實物如下:1、Buck控制器選型電源框圖制作過程,可以參考前期文檔:硬件總體設計之 “專題分析”我們可以看到在電源樹中,分別需要實現:5V→3.3V@2A5V→1.2V@2A5V→2.5V@2A此處我們選型的Buck電源控制器(集成Mosfet)是杰華特的JW5359從Datasheet我們可以看到:1、輸入電壓范圍滿足要求4.5V~18V2、輸出電流可以達到
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電路設計 FPGA BUCK電路
- 本系列文章從數字芯片設計項目技術總監的角度出發,介紹了如何將芯片的產品定義與設計和驗證規劃進行結合,詳細講述了在FPGA上使用IP核來開發ASIC原型項目時,必須認真考慮的一些問題。文章從介紹使用預先定制功能即IP核的必要性開始,通過闡述開發ASIC原型設計時需要考慮到的IP核相關因素,用八個重要主題詳細分享了利用ASIC所用IP來在FPGA上開發原型驗證系統設計時需要考量的因素。在上篇文章中,我們介紹了將ASIC IP移植到FPGA原型平臺上的必要性,并對原型設計中各種考量因素進行了總體概述,分析開發A
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ASIC IP FPGA SmartDV
- 隨著人工智能(AI)技術的飛速發展,其應用邊界不斷拓寬,從簡單的圖像識別到復雜的自然語言處理,再到自動駕駛、智能制造等前沿領域,AI 正以前所未有的速度改變著我們的世界。在這場 AI 革命中,深度學習作為其核心驅動力,不斷推動著算法與模型的革新,同時也對計算資源提出了更為嚴苛的要求。誕生于 1985 年的 FPGA 雖然問世時間不長,但已經憑借「可編程」的獨特優勢,在百花齊放的芯片浪潮中奪得一席之地,成為 GPU 芯片的又一勁敵。FPGA 的特點FPGA 芯片是基于可編程器件(PAL、GAL、CPLD)發
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FPGA
- 本文從數字芯片設計項目技術總監的角度出發,介紹了如何將芯片的產品定義與設計和驗證規劃進行結合,詳細講述了在FPGA上使用IP核來開發ASIC原型項目時,必須認真考慮的一些問題。文章從介紹使用預先定制功能即IP核的必要性開始,通過闡述開發ASIC原型設計時需要考慮到的IP核相關因素,用八個重要主題詳細分享了利用ASIC所用IP來在FPGA上開發原型驗證系統設計時需要考量的因素。本篇文章是SmartDV數字芯片設計經驗分享系列文章的第一篇,作為全球領先的驗證解決方案和設計IP提供商,SmartDV的產品研發及
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FPGA SmartDV
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