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Verilog HDL基礎知識3之抽象級別

  • Verilog可以在三種抽象級別上進行描述：行為級模型、RTL級模型和門級模型。行為級（behavior level）模型的特點如下。1、它是比較高級的模型，主要用于testbench。2、它著重于系統行為和算法描述，不在于系統的電路實現。3、它不可以綜合出門級模型。4、它的功能描述主要采用高級語言結構，如module、always、initial、fork/join/task、function、for、repeat、while、wait、event、if、case、@等。RTL級（register tr
  • 關鍵字： FPGA  verilog HDL  抽象級別  

Verilog HDL基礎知識2之運算符

  • Verilog HDL 運算符介紹算術運算符首先我們介紹的是算術運算符，所謂算術邏輯運算符就是我們常說的加、減、乘、除等，這類運算符的抽象層級較高，從數字邏輯電路實現上來看，它們都是基于與、或、非等基礎門邏輯組合實現的，如下。/是除法運算，在做整數除時向零方向舍去小數部分。%是取模運算，只可用于整數運算，而其他操作符既可用于整數運算，也可用于實數運算。例子：我們在生成時鐘的時候，必須需選擇合適的timescale和precision。當我們使用“PERIOD/2”計算延遲的時候，必須保證除法不會舍棄小數部
  • 關鍵字： FPGA  verilog HDL  運算符  

如何用內部邏輯分析儀調試FPGA？

  • 1 推動FPGA調試技術改變的原因　　進行硬件設計的功能調試時，FPGA的再編程能力是關鍵的優點。CPLD和FPGA早期使用時，如果發現設計不能正常工作，工程師就使用“調試鉤”的方法。先將要觀察的FPGA內部信號引到引腳，然后用外部的邏輯分析儀捕獲數據。然而當設計的復雜程度增加時，這個方法就不再適合了，其中有幾個原因。第一是由于FPGA的功能增加了，而器件的引腳數目卻緩慢地增長。因此，可用邏輯對I/O的比率減小了，參見圖1。此外，設計很復雜時，通常完成設計后只有幾個空余的引腳，或者根本就沒有空余的引腳能用
  • 關鍵字： FPGA  邏輯分析儀  

xilinx FPGA中oddr，idelay的用法詳解

  • 我們知道xilinx FPGA的selectio中有ilogic和ologic資源，可以實現iddr/oddr，idelay和odelay等功能。剛入門時可能對xilinx的原語不太熟練，在vivado的tools-> language templates中搜索iddr idelay等關鍵詞，可以看到A7等器件下原語模板。復制出來照葫蘆畫瓢，再仿真一下基本就能學會怎么用了。1. oddroddr和iddr都一樣，以oddr為例，先去templates里把模板復制出來。Add simulation s
  • 關鍵字： xilinx FPGA  oddr  idelay  

FPGA實現OFDM通信

  • OFDM中調制使用IFFT，解調使用IFFT，在OFDM實現系統中，FFT和IFFT時必備的關鍵模塊。在使用Xilinx的7系列FPGA（KC705）實現OFDM系統時，有以下幾種選擇：（1）在Vivado中調用官方的FFT的IP核（AXI-Stream總線）；（2）在Vivado HLS中調用官方的FFT的IP核（內部FFT通信AXI-Stream總線），可以自己增加外部封裝接口類型；（3）Verilog編寫FFT，很復雜，找到了一個1024點的并行流水線的，但是資源耗費太大，8192點時很難滿足，不采
  • 關鍵字： FPGA  OFDM  通信  

萊迪思榮獲匯川技術（Inovance）優秀質量獎

  • 中國上海——2024年1月29日——萊迪思半導體（NASDAQ：LSCC），低功耗可編程器件的領先供應商，今日宣布在由全球600多家供應商和合作伙伴參加的匯川技術年度供應商大會上榮獲“優秀質量獎”。匯川技術表彰的企業提供創新的解決方案，可加速其工業自動化解決方案開發，幫助制造商提高生產效率和加工精度。萊迪思半導體銷售副總裁王誠表示：“在萊迪思，我們專注于與客戶密切合作，通過我們的低功耗、小尺寸解決方案和服務，幫助他們實現設計目標并縮短產品上市時間。我們很榮幸匯川授予我們這一享有盛譽的獎項，我們期待與匯川繼
  • 關鍵字： 萊迪思  匯川  Inovance  FPGA  低功耗可編程器件  

Verilog HDL簡介&基礎知識1

  • Verilog 是 Verilog HDL 的簡稱，Verilog HDL 是一種硬件描述語言（HDL：Hardware Description Language），硬件描述語言是電子系統硬件行為描述、結構描述、數據流描述的語言。利用這種語言，數字電路系統的設計可以從頂層到底層（從抽象到具體）逐層描述自己的設計思想，用一系列分層次的模塊來表示極其復雜的數字系統。然后，利用電子設計自動化（EDA)工具，逐層進行仿真驗證，再把其中需要變為實際電路的模塊組合，經過自動綜合工具轉換到門級電路網表。接下去，再用專用
  • 關鍵字： FPGA  verilog HDL  EDA  

貿澤順利完成SOC 2 Type II、ISO 27001 Stage 2和Cyber Essentials認證

  • 2024年1月26日 – 專注于推動行業創新的知名新品引入 (NPI) 代理商?貿澤電子 (Mouser Electronics) 宣布已成功完成SOC 2 Type II、ISO 27001和Cyber Essentials認證。貿澤電子有嚴格的流程來保護我們的數據、系統和產品的安全、隱私及可用性，并已獲得1,200多家半導體和電子元器件制造商的授權，值得客戶信賴。貿澤遵守嚴格的數據安全標準，致力于利用其全面的信息安全管理系統 (ISMS) 管理網絡安全并將風險降至最低。貿澤注冊上述
  • 關鍵字： 貿澤  SOC 2 Type II  ISO 27001 Stage 2  Cyber Essentials  

三星 Exynos 2400 芯片性能測試，光追性能力壓高通驍龍 8 Gen 3

  • IT之家 1 月 26 日消息，根據 Golden Reviewer 公布的評測結果，在測試手機光線追蹤性能的 3DMark Solar Bay 測試中，三星 Exynos 2400 表現最佳。根據測試結果，三星 Exynos 2400 芯片得分為  8642 分，耗電量為 9.3W；作為對比高通驍龍 8 Gen 3 芯片得分為  8601 分，耗電量為 11.7W。這表明三星 Exynos 2400 芯片在支持光線追蹤的游戲上，性能最強最高效，凸顯了基于 AMD RDNA
  • 關鍵字： 三星  SoC  Exynos 2400  

谷歌 Tensor 芯片專利侵權案達成和解，原告索賠 16.7 億美元

  • IT之家 1 月 25 日消息，根據美國馬薩諸塞州聯邦法院公示的文件，一起關于谷歌 Tensor 芯片侵權的專利訴訟已經達成和解，但目前并未披露和解細節。IT之家今年 1 月 10 日報道，奇點計算公司（Singular Computing）起訴谷歌，指控該公司 AI 處理器侵犯其兩項技術專利，索賠 70 億美元（當前約 501.9 億元人民幣），在庭審過程中修改為索賠 16.7 億美元（IT之家備注：當前約 119.74 億元人民幣）。這起訴訟原告是奇點計算公司（Singular Comput
  • 關鍵字： 谷歌  Tensor  SoC  

基于Kintex-7 FPGA的核心板電路設計

  • 1. 引言Field Programmable GateArray（簡稱，FPGA）于1985年由XILINX創始人之一Ross Freeman發明，第一顆FPGA芯片XC2064為XILINX所發明，FPGA一經發明，后續的發展速度之快，超出大多數人的想象，近些年的FPGA，始終引領先進的工藝。在通信等領域FPGA有著廣泛的應用，通信領域需要高速的通信協議處理方式，另一方面通信協議隨時都在修改，不適合做成專門的芯片，所以能夠靈活改變的功能的FPGA就成了首選。并行和可編程是FPGA最大的優勢。2.核心板
  • 關鍵字： FPGA  Kintex-7  電路設計  

Spoc CPU軟核 Part 4-軟件（即程序員）模型

  • ...或如何將外圍設備連接到 Spoc。Spoc 內存模型Spoc0 數據存儲器空間深度為 64Kbits。從 0x0000 到 0x0FFF 的地址保留供內部使用。從 0x1000 到 0xFFFF 的地址可供外部外設免費使用。讓我們看看如何使用它！寫入外圍設備寫入事務的寬度可以是 1、8、16 或 32 位。例如：do?#0x1000?->?WA0 do.byte?#0x55?->?@???&nbs
  • 關鍵字： FPGA  Spoc  

Spoc CPU軟核 Part 3-軟件（即程序員）模型

  • Spoc 有一個小指令集和一些尋址模式。這使得 Spoc 程序員的模型易于學習。指令集Spoc 目前支持 8 條指令：例子：?inc?RA2??????//?increments?register?RA2? ?dec?A???????//?decrements?accumula
  • 關鍵字： FPGA  Spoc  

Spoc CPU軟核 Part 2-主要特征

  • 邏輯使用量小通用架構，可在 Xilinx 和 Altera FPGA 中輕松運行。也可以很容易地移植到ASIC。RISC：小指令集多個累加器，多種數據大小雙寄存器文件每條指令中的條件執行數據存儲器：使用（至少）一個模塊代碼存儲器：使用串行閃存或塊Spoc被設計為幾乎是免費的，即在FPGA中占用很少的空間，并從串行閃存中執行。 許多新的FPGA板卡都已使用串行閃存來配置FPGA。 Spoc 可以使用閃存中未使用的內存空間作為代碼內存。Spoc0Spoc 可以參數化。目前，第一個實現“Spoc0”不是。Spo
  • 關鍵字： FPGA  Spoc  

Spoc CPU軟核 Part 1-Hello world!

  • Spoc 是一個 cpu...你猜怎么著？讓我們用它來顯示“Hello world！”。在本例中，您需要一個帶有 RS-232 輸出的 FPGA 板。1. 軟件使用?spoc_asm?編譯以下代碼// First set the stack pointer (required since we use a subroutine below) ?do #0x0C00 -> SPBeginString: ?do #GreetingString -> CSSe
  • 關鍵字： FPGA  Spoc  
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