針對π網絡石英晶體參數測試系統，采用以STM32F103ZET6型ARM為MCU控制DDS產生激勵信號。該測試系統相對于傳統的PC機測試系統具有設備簡單、操作方便，較之普通單片機測試系統又具有資源豐富、運算速度更快等優點。AD9852型DDS在ARM控制下能產生0～100 MHz掃頻信號，經試驗數據分析得到信號精度達到0.5×10-6，基本滿足設計要求。該系統將以其小巧、快速、操作方便、等優點被廣泛采用。
產生正弦激勵信號一般可以通過振蕩電路或直接數字頻率合成器(Direct
關鍵字：
石英晶體 DDS
1.引言
DDS頻率合成器具有頻率分辨率高，輸出頻點多，可達2N個頻點(假設DDS相位累加器的字長是N);頻率切換速度快，可達us量級;頻率切換時相位連續的優點，可以輸出寬帶正交信號，其輸出相位噪聲低，對參考頻率源的相位噪聲有改善作用;可以產生任意波形;全數字化實現，便于集成，體積小，重量輕。
本文介紹了DDS的基本原理，同時針對DDS波形發生器的FPGA實現進行了簡要介紹，利用SignalTapII嵌入式邏輯分析儀對正弦波、三角波、方波、鋸齒波進行仿真驗證。
2.DDS波形發生器的
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DDS 波形發生器
1971年，美國學者TIERNCY J、TADER C M和GOLD B在《A Digital Frequeney Synthesizer》一文中提出了以全數字技術，從相位概念出發直接合成所需波形的一種新的頻率合成原理，稱之為直接數字頻率合成器DDS(Direct Digitial Frequency Synthesis)[1].這是頻率合成技術的一次重大革命，但限于當時微電子技術和數字信號處理技術的限制，DDS并沒有得到足夠的重視。隨著現代超大規模集成電路集成工藝的高速發展，數字頻率合成技術得到了質
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FPGA DDS
文中介紹的干擾器能夠產生3種干擾信號：隨機干擾、點頻干擾和掃頻干擾，其中點頻干擾和掃頻干擾是基于單片機對DDS芯片AD9852的控制產生，整個系統的控制靈活、高效。測試結果表明，系統能夠準確產生所需要的干擾信號，滿足抗干擾性能測試的需要。雖然本設計產生的干擾信號位于406 MHz頻段，但這樣的電路結構也可用于其它頻段(需修改VCO、PLL等電路)，例如手機通信頻段，因此本電路結構對其它頻段的應用同樣具有借鑒意義。
隨著電子設備的使用越來越普遍，電子設備之間的干擾問題也越來越突出，特別是通信設備的
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DDS AD9852
介紹了直接數字頻率合成(DDS)的結構和原理，并將DDS技術應用于短波射頻通信頻率源中。實現了一種基于單片機+DDS可編程低噪聲頻率源，輸出信號范圍46.5~75 MHz.實驗結果表明，該頻率源具有頻率分辨率高、相位噪聲低等優點，滿足短波射頻通信系統對頻率源的設計要求。
頻率源是現代短波射頻通信系統的核心，對整個系統的正常運行起著決定性的作用。作為射頻電路與系統的核心設備，頻率源的好壞關系著整個系統的穩定性?，F在的頻率合成技術正朝著雜散和相位噪聲更低的方向發展，同時還要求有更寬的頻帶和更高的頻率
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DDS 射頻
摘要：基于零中頻正交解調原理的頻率特性測試儀，用于檢測被測網絡的幅頻特性和相頻特性。系統采用集成數字直接頻率合成器AD9854產生雙路恒幅正交余弦信號，作為掃頻信號源，以FPGA為控制核心和運算平臺，結合濾波器、放大器、混頻器及ADC電路，實現對雙端口網絡在1-40MHz頻率范圍內頻率特性的點頻和掃頻測量，并在LCD屏上實時顯示相頻特性曲線和幅頻特性曲線。
引言
AD9854數字合成器是高度集成的器件，它采用先進的DDS技術，片內整合了兩路高速、高性能正交D/A轉換器，在高穩定度時鐘的驅動
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AD9854 FPGA 濾波器 DDS ADC 201504
摘要：隨著通信行業以及數字技術的不斷發展，市場上經常需要多模通信信號或多制式數字調制信號發生器，本文介紹了采用軟件無線電思想，基于“DDR2+FPGA+DAC+DDS+寬帶調制器”的硬件結構的信號發生裝置，實現了TD-SCDMA、WCDMA、TD-LTE、FDD-LTE等多模信號以及BPSK、QPSK、OQPSK、DQPSK、8PSK、16QAM、32QAM、64QAM、2FSK、4FSK、GMSK等數字調制信號的發生，能很好滿足現代信號模擬的實際需求。
1 引言
關鍵字：
多模 調制信號 FPGA DDS FIR濾波器 201504
一、為啥要說任意分頻
也許FPGA中的第一個實驗應該是分頻實驗，而不是流水燈，或者LCD1602的"Hello World"顯示，因為分頻的思想在FPGA中極為重要。當初安排流水燈，只是為了能讓大家看到效果，來激發您的興趣(MCU的學習也是如此)。
在大部分的教科書中，都會提到如何分頻，包括奇數分頻，偶數分頻，小數分頻等。有些教科書中也會講到任意分頻(半分頻，任意分數分頻)原理，用的是相位與的電路，并不能辦到50%的占空比，也不是很靈活。
但沒有一本教科書會講到精
關鍵字：
FPGA DDS
1 引言
頻率源是所有電子系統(雷達、通訊、測控、導航等)的基本信號來源，其主要包括固定頻率源和合成頻率源兩類。其中合成頻率源又稱頻率合成(綜合)器，按其構成方式可分為直接式和間接式。采用鎖相環(PLL)技術的間接頻率合成器目前應用最為廣泛。直接模擬頻率合成器(DAS)采用倍頻器、分頻器、混頻器及微波開關來實現頻率合成，具有最優的近端相位噪聲和高速捷變頻特性，但結構復雜、成本昂貴的特點限制其只能應用于雷達等高端領域。直接數字合成器(DDS)目前也得到了廣泛應用，但高性能DDS產品的輸出頻率還有待
關鍵字：
X波段 頻率綜合器 DDS
1 引言
直接數字頻率合成(DDS)是近幾年一種新型的頻率合成法，其具有頻率切換速度快，頻率分辨率高，以及便于集成等優點。在此，設計了基于DDS的頻譜分析儀，該頻譜分析儀依據外差原理，被測信號與本征頻率混頻，實現信號的頻譜分析。
2 系統設計
圖1給出系統設計框圖，主要由本機振蕩電路、混頻電路、放大檢波電路、頻譜輸出顯示電路等組成。通過單片機和現場可編程門陣列(FPGA)共同控制AD985l，以產生正弦掃頻輸出信號，然后經濾波、程控放大得到穩定輸出，與經放大處理的被測信號混頻，再經放
關鍵字：
DDS FPGA AD985l
摘要：本文介紹了一種C波段寬帶捷變頻率綜合器的設計方法，采用直接數字頻率合成器(DDS)實現頻率捷變，采用倍頻鏈路擴展輸出帶寬，通過與鎖相環(PLL)合成產生的本振信號混頻將輸出頻率搬移到C波段。論述了DDS時鐘電路、倍頻鏈路以及混頻部分的設計方法，并給出了達到的主要技術指標和測試結果。
引言
頻率合成器是現代通訊系統必不可少的關鍵電路， 是電子系統的主要信號源，是決定電子系統性能的關鍵設備。隨著系統對頻率源的頻率穩定度、頻譜純度、頻率范圍和輸出頻率個數的要求越來越高，高穩定、低相位噪聲、
關鍵字：
變頻率綜合器 DDS PLL C波段 合成器 201410
摘要：傳統的多路同步信號源常采用單片機搭載多片專用DDS芯片配合實現。該技術實現復雜，且在要求各路同步相干可控時難以實現。本文在介紹了DDS原理的基礎上，給出了用Verilog_HDL語言實現相干多路DDS的工作原理、設計思路、電路結構。利用Modelsim仿真驗證了該設計的正確性，本設計具有調相方便，相位連續，頻率穩定度高等優點。
關鍵詞：DDS;現場可編程門陣列(FPGA);相位累加器;Verilog_HDL
實現信號源的多路同步輸出且各路間擁有固定的相位關系，在雷達、通信等多領域有著重要的應用。
關鍵字：
FPGA DDS
摘要 基于直接數字頻率合成技術DDS的原理，分析了影響DDS頻率輸出的核心因素。在此基礎上仿真驗證了相位累加器的位數對DDS頻率輸出的作用。介紹了一種DDS芯片AD9852并基于這種芯片提出了一種雷達回波模擬器的設計，并分析了DDS芯片的優缺點。該設計能夠穩定地產生70 MHz載頻的雷達回波，較好地模擬出所需回波。
關鍵詞 DDS;相位累加器;AD9852
直接數字頻率合成技術(DDS)是繼直接頻率合成技術和鎖相環式頻率合成技術之后的第三代頻率合成技術，它的原理是在采樣頻率一定的條件下，通過控制兩次連
關鍵字：
DDS AD9852
摘要 針對π網絡石英晶體參數測試系統，采用以STM32F103ZET6型ARM為MCU控制DDS產生激勵信號。該測試系統相對于傳統的PC機測試系統具有設備簡單、操作方便，較之普通單片機測試系統又具有資源豐富、運算速度更快等優點。AD9852型DDS在ARM控制下能產生0～100 MHz掃頻信號，經試驗數據分析得到信號精度達到0.5×10-6，基本滿足設計要求。該系統將以其小巧、快速、操作方便、等優點被廣泛采用。
關鍵詞 石英晶體;DDS;AD9852;STM32F103ZET6
產生
關鍵字：
ARM DDS
摘要：為了提高數字調制信號發生器的頻率準確度和穩定度，并使其相關技術參數靈活可調，提出了基于FPGA和DDS技術的數字調制信號發生器設計方法。利用Matlab/Simulink、DSP Builder、QuartusⅡ3個工具軟件，進行基本DDS建模，然后在DDS模塊的基礎上，通過單片機等電路組成的控制單元的邏輯控制作用，根據通信系統中數字調制方式的基本原理，設計并實現了數字調制信號發生器，從而實現二進制頻移鍵控(2FSK)、二進制相移鍵控(2PSK)和二進制幅移鍵控(2ASK)3種基本的二進制數字調制。
關鍵字：
FPGA DDS
直接數字合成（dds）技術介紹
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