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基于數據選擇器和D觸發器的多輸入時序電路設計

作者: 時間:2010-08-12 來源:網絡 收藏
在SSI邏輯中,遵循的設計準則是:在保證所設計的邏輯電路具有正確功能的前提下,的激勵函數應最小化,從而簡化電路結構。用卡諾圖法或公式法化簡的激勵函數,在多變量時相當繁瑣甚至難以進行。因此,需要尋求多邏輯電路簡捷設計方法。本文給出多變量時序邏輯網絡的一種新型結構:將D器進行組合,構成既有存儲功能又有功能的多輸入時序網絡,并給出設計過程中不需要進行函數化簡的設計技術。

1 基本原理
1.1 基本多輸入時序網絡
1.1.1 多輸入時序網絡的基本形式

用1個D觸發器和1個2選1器構成多輸入時序網絡的基本電路,如圖1所示。

本文引用地址:http://www.j9360.com/article/180616.htm


圖1中,觸發器的現態輸出Qn作為數據選擇器的A選擇輸入變量,數據選擇器的Y輸出作為觸發器的D輸入信號,數據選擇器的輸入端D0,D1作為所構成時序網絡的外部信號輸入端。
1.1.2 多輸入時序網絡基本電路的狀態方程
由D觸發器的特性方程Qn+1=D、數據選擇器的輸出邏輯表達式的關系,得多輸入時序網絡基本電路的狀態方程:

寫成矩陣形式為:

1.1.3 已知狀態轉換關系確定時序網絡輸入矩陣參數的方法
由式(1)、式(2)有:
(1)現態Qn=0時,Qn+1=D0,選擇輸入D0,由狀態轉換關系確定D0。可實現所要求的狀態轉換:
若Qn+1=O,即狀態轉換為0→O,則式(2)中的輸入矩陣應填D0=0;
若Qn+1=1,即狀態轉換為O→1,則式(2)中的輸入矩陣應填D0=使狀態產生變化的輸入變量。


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