- 近年來,隨著信息科技的發展,電子存包系統由于其安全性高、可靠性高、方便快捷等特點,在車站碼頭、超市、圖書館、賓館、游泳館、俱樂部等公共場所及機關、企事業單位文件檔案管理等部門得到了廣泛的應用,有著廣闊的市場前景。
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CPLD
- CPLD（Complex Programmable Logic Device）是Complex PLD的簡稱,一種較PLD為復雜的邏輯元件。CPLD是一種用戶根據各自需要而自行構造邏輯功能的數字集成電路。其基本設計方法是借助集成開發軟件平臺，用原理圖、硬件描述語言等方法，生成相應的目標文件，通過下載電纜（“在系統”編程）將代碼傳送到目標芯片中，實現設計的數字系統。
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CPLD
- 基于單片機和CPLD的DDS正交信號源，其頻率幅度可精密控制，擴展輸出頻率達300 kHz，增加掃頻輸出功能。采用紅外鍵盤控制頻率和幅度，采用液晶同步顯示信號的頻率和幅度；輸出端產生正弦波、方波、三角波、鋸齒波，梯形波、短形波、頻率突變的方波、尖脈沖數字信號等，且具有掃頻輸出的功能。測試結果表明，系統穩定可靠，人機交互界面友好，操作簡單方便。
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DDS 正交信號源 CPLD 濾波器 DT9205 AT28C64
- SOPC一詞主要是源自Altera, 其涵義是因為目前CPLD/FPGA的容量愈來愈大, 性能愈來愈好, 加上價格下跌的推波助瀾之下, 以往ASIC產品才能具有的 SoC觀念, 也能移植到CPLD/FPGA上, 并且因為CPLD/FPGA的可編程(Programmable)能力, 使得CPLD/FPGA不僅能實現一個高復難度的系統, 而且還能快速改變系統的特性. 類似的觀念也鑒于Xilinx的Platform FPGA.
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SOPC CPLD FPGA
- 本文提出一種基于CPLD的簡易字符疊加器，具有成本低、抗干擾性能好等特點，適用于視頻監控。由于采用了CPLD器件，增強了系統集成度和設計靈活性。
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字符疊加器 RAM CPLD VHDL
- 設計了一組基于CPLD的PLC背板總線協議接口芯片，協議芯片可以區分PLC的背板總線的周期性數據和非周期性數據。詳細介紹了通過Verilog HDL語言設計狀態機、協議幀控制器、FIFO控制器的過程，
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PLC FIFO CPLD 總線協議
- 1 引言近年來，由于微電子學和計算機技術的迅速發展，給EDA技術行業帶來了巨大的變化。 HDL（hardware description language）硬件描述語言是一種描述電路行為的
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Verilog CPLD FPGA HDL 漢明碼
- 介紹了一種基于CPLD的圖像采集系統,詳細論述了線陣CCD的驅動方法、圖像信號的處理與傳輸,并給出了測試結果。此系統很好地完成了高速運動狀態下的圖像采集工作。
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CCD 圖像采集 CPLD
- GPIB控制器芯片是組建自動測試系統的核心，在測試領域應用廣泛。本文擬討論用ALTERA公司的低成本 CPLD 來實現 GPIB 控制器的功能。GPIB 控制器芯片的硬件設計主 要分為狀態機的實現、數據通道和微處理接口的設計。本文重點介紹了各個模塊的實現原理。
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GPIB控制器 自動測試系統 CPLD
- 現場可編程邏輯門陣列（FPGA）在通信系統中的應用越來越廣泛。隨著通信系統的復雜化和功能多樣化,很多系統需要在不同時刻實現不同的功能,多數場合需要FPGA能夠支持在線動態配置;在某些安全領域,需要對FPGA程序進行加密存儲、動態升級。這里根據應用趨勢提出了一種基于CPU＋CPLD的可靠的FPGA動態加載方法。該方法具有靈活、安全、可靠的特點,在通信電子領域具有一定的參考價值。
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動態配置 FPGA CPLD
- 文本信息用戶可能樂意以體積換取 QWERTY 鍵盤，因為文本輸入大為簡便了，而且兩個大拇指都可以用來輸入文本信息或數據。最近，有些手機生產商已經推出了面向文本用戶的帶 QWERTY 鍵盤的手機。
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QWERTY鍵盤 GPIO CPLD
- 提出了一種基于CPLD的頻率響應特性測試卡設計方案,分析了DDS原理的CPLD實現方法,給出了數據處理算法流程,并進行了設計驗證實驗,結果表明在逐點單頻測試狀態下,相位和幅值測量與標準儀器相比相位差小于0.5°,幅值差小于0.1dB。
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頻率響應 DDS原理 CPLD
- 本文結合實際應用需要，設計了基于復雜可編程邏輯器件(CPLD)的線陣CCD數據采集系統。著重介紹了數據采集的特點及該系統軟、硬件設計和最后的性能評價。
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數據采集系統 CCD CPLD
- 如果能充分利用P89C669的豐富的線性地址資源，將能大大增強系統能力。在一個嵌入式系統開發中，筆者采用ALTERA公司的CPLD芯片EPM7032利用這款單片機的線性地址擴展了豐富的外部設備資源。
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線性地址 存儲器擴展 CPLD
- 提出了一種基于DSP及CPLD的掘進機控制系統設計方案,介紹了系統總體設計、CPLD數據采集模塊及CPLD邏輯控制模塊的設計。該系統采用CPLD實現數據采集,在AD采樣環節節省DSP等待時間12μs,25路模擬信號每個采樣周期節省300μs;采用CPLD代替標準邏輯器件實現各種邏輯功能,簡化了硬件電路的設計,提高了控制系統集成度。實際應用表明,該系統能夠滿足掘進機正常生產的要求,具有較強的實時性和較高的可靠性。
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掘進機控制系統 AD采樣 CPLD
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