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基于Verilog HDL的SDX總線與Wishbone總線接口轉化的設計與實現

  • 針對機載信息采集系統可靠性、數據管理高效性以及硬件成本的需求，介紹了基于硬件描述語言Verilog HDL設計的SDX總線與Wishbo ne總線接口轉化的設計與實現，并通過Modelsim進行功能仿真，在QuartusⅡ軟件平臺上綜合，最終在Altera公司的CyclONeⅢ系列FPGA上調試。實驗證明了設計的可行性。
  • 關鍵字： SDX總線  Wishbone總線  FPGA  
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sdx總線介紹

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