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加減法運算電路的設計方法

作者: 時間:2011-01-10 來源:網絡 收藏

解出R’=40kΩ。
例2,試設計實現u=2u121-3u111-u112運算關系的加減運算
將所要實現的運算關系式與式(4)對比,確定式(4)中各輸入信號的比例系數為

本文引用地址:http://www.j9360.com/article/187655.htm

q.JPG

r.JPG
例3,試設計實現u0=2u121+u122-1.5u111-0.5u112運算關系的加減運算
將所要實現的運算關系式與式(4)對比,確定式(4)中各輸入信號的比例系數為

確定所設計的形式為圖1中去掉電阻R’及Rp,按四個輸入信號重畫如圖4所示。

b.JPG
選取RF=150kΩ,代入各輸入信號的比例系數表達式中,解出

c.JPG
4 結語
本文討論了加減運算電路的構成形式及比例系數適應范圍,從而可實現輸入信號以任意比例系數參與運算的電路設計,使運算電路具有普遍適用性。

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