采用FPGA的可編程電壓源系統原理及設計
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程序中，duty為控制占空比的參數；count為控制分頻的參數。通過改變duty和count兩個參數，得到占空比及分頻數可調的時鐘信號，極為方便。
2．2 其他模塊的實現
其他控制模塊包括地址發生器、DAC控制電路、并／串轉換電路。存儲數據中只讀存儲器ROM是通過QuartusII軟件中Mega Wizard Plug-In Manager命令定制元件的。地址發生器產生地址信號addr_tom和讀使能信號clk_rom，對ROM中的數據進行讀取。讀取到的數據data為并行數據，由于采用的是串行數據輸入的數／摸轉換器，所以要進行并／串轉換。data并行數據在load使能信號的作用下，賦植給寄存器data_q，經并／串轉換電路對data_q進行從高位到低位的并／串轉換。在DAC控制電路產生讀數據信號clk_dac和片選信號cs_dac的作用下，轉換電路的輸出信號從高位到低位串行讀入數／模轉換器DAC中。完整程序如下：
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