隨著筆記本電腦、手機等移動終端以及家用數碼產品的大規模增長，器的移動性和能耗問題已廣泛受到業界關注。日前，(全球半導體組織)委員會會議在上海舉行，推動存儲工業新標準制定。
在過去五年內，JEDEC曾與中國半導體行業組織合作，促進中國及世界的半導體行業標準。例如中國電子標準協會(CESA)，中國半導體行業協會(CSIA)與中國電子標準研究所(CESI)等。
我國企業已占JEDEC會員數的20%，而且數目還在增長。JEDEC本次會議主要研究了DDR3 SDRAM（第三代雙倍速率同步動態隨機存儲
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SDRAM DRAM
實現數據的高速大容量存儲是數據采集系統中的一項關鍵技術。本設計采用Altera公司Cyclone系列的FPGA完成了對DDR SDRAM的控制，以狀態機來描述對DDR SDRAM的各種時序操作，設計了DDR SDRAM的數據與命令接口。用控制核來簡化對DDR SDRAM的操作，并采用自頂至下模塊化的設計方法，將控制核嵌入到整個數據采集系統的控制模塊中，完成了數據的高速采集、存儲及上傳。使用開發軟件Quartus II中內嵌的邏輯分析儀SignalTap II對控制器的工作流程進行了驗證和調試。最終采集到的
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FPGA DDR SDRAM 數據采集
隨著設計與制造技術的發展,集成電路設計從晶體管的集成發展到邏輯門的集成, 現在又發展到IP的集成,即SoC設計技術。SoC可以有效地降低電子信息系統產品的開發成本,縮短開發周期,提高產品的競爭力,是工業界將采用的最主要的產品開發方式。目前國內也加大了在SoC 設計以及IP 集成領域的研究。本文介紹的便是國家基金項目支持的龍芯SoC—ICT- E32 設計所集成的片上SDRAM 控制器模塊設計與實現。
1 ICT-E32 體系結構
ICT-E32 是一款32位高性能SoC ,它集成龍芯1號
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SoC SDRAM 控制器 MCU和嵌入式微處理器
DDR3 SDRAM內存的總線速率達到600 Mbps to 1.6 Gbps (300 to 800 MHz)，1.5V的低功耗工作電壓，采用90nm制程達到2Gbits的高密度。這個架構毫無疑問更快、更大，每比特的功耗也更低，但是如何實現FPGA和DDR3 SDRAM DIMM條的接口設計呢？ 關鍵字：均衡（leveling） 如果FPGA&nbs
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FPGA DDR3 SDRAM 接口 模擬IC 電源
在高速數字視頻系統應用中，使用大容量存儲器實現數據緩存是一個必不可少的環節。SDRAM就是經常用到的一種存儲器。
但是，在主芯片與SDRAM之間產生的時序抖動問題阻礙了產品的大規模生產。在數字電視接收機的生產實際應用中，不同廠家的PCB板布線、PCB材料和時鐘頻率的不同，及SDRAM型號和器件一致性不同等原因，都會帶來解碼主芯片與SDRAM間訪問時序的抖動問題。
本文利用C-NOVA公司數字電視MPEG-2解碼芯片AVIA9700內置的SDRAM控制器所提供的時序補償機制，設計了一個方便使
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嵌入式系統 單片機 SDRAM 時序控制 MCU和嵌入式微處理器
引言 同步動態隨機存儲器(SDRAM)，在同一個CPU時鐘周期內即可完成數據的訪問和刷新，其數據傳輸速度遠遠大于傳統的數據存儲器(DRAM)，被廣泛的應用于高速數據傳輸系統中?；贔PGA的SDRAM控制器，以其可靠性高、可移植性強、易于集成的特點，已逐漸取代了以往的專用控制器芯片而成為主流解決方案。然而，SDRAM復雜的控制邏輯和要求嚴格的時序，成為開發過程中困擾設計人員主要因素，進而降低了開發速度，而且大多數的基于FPGA的SDR
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工業控制 嵌入式系統 單片機 FPGA SDRAM 嵌入式 工業控制
1 引言隨著雷達技術發展，大帶寬高分辨力、多種信號處理方式的采用，使得實時信號處理對數據的處理速度大大提高。同時在雷達信號處理中運算量大，數據吞吐量急劇上升，對數據處理的要求不斷提高。隨著大規模集成電路技術的發展，作為數字信號處理的核心數字信號處理器(DSP)得到了快速的發展和應用。ADSP-TS201DSP是美國模擬器件(ADD公司繼TSl01之后推出的一款高性能處理器。此系列DSP性價比很高，兼有FPGA和ASIC信號處理性能和指令集處理器的高度可編程性，適用于大存儲量、高性能、高速度的信號處理和圖像
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模擬技術 電源技術 SDRAM DSP-TS201 總線接口 模擬IC 電源
Altera PCI Express到DDR2 SDRAM 參考設計,OverviewAltera offers a PCI Express to DDR2 SDRAM reference design that demONSTrates the operation of Alteras PCI Express (PCIe) MegaCorereg; product. This reference design provides an interface betw
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參考 設計 SDRAM DDR2 PCI Express Altera
Altera宣布，在FPGA業界實現了對高性能DDR3存儲器接口的全面支持。在最近通過的JESD79-3 JEDEC DDR3 SDRAM標準下，Altera Stratix® III系列FPGA可以幫助設計人員充分發揮DDR3存儲器的高性能和低功耗優勢，這類存儲器在通信、計算機和視頻處理等多種應用中越來越關鍵。
這些應用處理大量的數據，需要對高性能存儲器進行快速高效的訪問。符合JESD79-3 JEDEC DDR3 SDRAM標準可滿足DDR3存儲器的1.5V低功耗電壓供電要求，在下一
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Altera SDRAM 存儲器
MIPS科技宣布，Kawasaki Microelectronics（K-micro）已采用 MIPS-Based™ Topaz 先進 SoC 計算子系統，進軍快速增長的無源光網絡（PON）市場。采用 MIPS32®24Kc™ 和 24Kf™ 處理器的 Topaz 有助于 PON 設計師更快更有效地推出高性能設備。K-m
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MIPS-Based SoC Topaz 計算子系統 消費電子 SoC ASIC 消費電子
在DSP應用系統中，需要大量外擴存儲器的情況經常遇到。例如，在數碼相機和攝像機中，為了將現場拍攝的諸多圖片或圖像暫存下來，需要將DSP處理后的數據轉移到外存中以備后用。從目前的存儲器市場看，SDRAM由于其性能價格比的優勢，而被DSP開發者所青睞。DSP與SDRAM直接接口是不可能的。
FPGA（現場可編程門陣列）由于其具有使用靈活、執行速度快、開發工具豐富的特點而越來越多地出現在現場電路設計中。本文用FPGA作為接口芯片，提供控制信號和定時信號，來實現DSP到SDRAM的數據存取。
1 SDRA
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DSP FPGA SDRAM 單片機 嵌入式系統 存儲器
在數字圖像處理、航空航天等高速信號處理應用場合，需要有高速大容量存儲空間的強力支持，來滿足系統對海量數據吞吐的要求。通過使用大容量同步動態RAM(SDRAM)來擴展嵌入式DSP系統存儲空間的方法，選用ISSI公司的IS42S16400高速SDRAM芯片，詳細論述在基于TMS320C6201(簡稱C6201)的數字信號處理系統中此設計方法的具體實現。 1 IS42S16400芯片簡介IS42S16400是ISSl公司推出的一種單片存儲容量高達64 Mb(即8 MB)的16位字寬高速SDRAM芯片。
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DSP SDRAM 單片機 嵌入式系統 存儲器
筆者在研究有關文獻的基礎上，根據具體情況提出一種獨特的方法，實現了對SDRAM的控制，并通過利用FPGA控制數據存取的順序來實現對數字視頻圖像的旋轉，截取、平移等實時處理。
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SDRAM 視頻處理器
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