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Synopsys IC Compiler II改變設計游戲規(guī)則后端物理設計吞吐量提高10倍

  • 　　亮點：　　設計規(guī)劃速度提升了10倍，實現(xiàn)速度提升了5倍，容量提升了2倍?–?它們共同使吞吐量加速了10倍　　構建于全新的可擴展基礎架構、時序和解析優(yōu)化引擎之上　　已經在成熟和新興的技術節(jié)點上成功生產流片　　為加速芯片和電子系統(tǒng)創(chuàng)新而提供軟件、知識產權(IP)及服務的全球性領先供應商新思科技公司日前宣布：正式推出將導致游戲規(guī)則發(fā)生改變的IC?Compiler?II，它是當前領先業(yè)界的布局和布線解決方案IC?Compiler?的繼任產品，可用于基于成熟和新
  • 關鍵字： Synopsys  IC  RTL  

Cadence宣布并購Forte Design Systems

  • 全球電子設計創(chuàng)新領先企業(yè)Cadence設計系統(tǒng)公司(NASDAQ: CDNS)日前宣布，已經達成了一項最終協(xié)議，收購以SystemC為基礎的高階綜合(HLS)與算法IP供應商Forte Design Systems。
  • 關鍵字： Cadence  SystemC  RTL  

如何調試數(shù)字硬件設計

  • 電子產品世界,為電子工程師提供全面的電子產品信息和行業(yè)解決方案,是電子工程師的技術中心和交流中心,是電子產品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網絡家園
  • 關鍵字： 數(shù)字硬件  RTL  參數(shù)測試  JTAG  

工程師設計手冊：集成“硬”IP模塊的幾點建議

  • 對“硬”IP模塊—那些以GDSII數(shù)據(jù)庫形式提交的模塊—的集成，讓系統(tǒng)設計工程師能夠把某些過去不得不在公...
  • 關鍵字： IP模塊  工程師經驗談  GDSII  

基于時序邏輯等效性檢查方法的RTL驗證

  • 寄存器傳輸級(RTL)驗證在數(shù)字硬件設計中仍是瓶頸。行業(yè)調研顯示，功能驗證占整個設計工作的70%。但即使把重點放在驗證上面，仍有超過60%的設計出帶需要返工。其主要原因是在功能驗證過程中暴露出來的邏輯或功能瑕疵和
  • 關鍵字： RTL  時序邏輯  等效  檢查方法    

用RTL測試平臺驗證事務級IP模型

  • 在系統(tǒng)級芯片設計中，設計驗證是一項十分重要的工作。傳統(tǒng)的驗證方法雖然比較簡單，但對設計工程師要求很高，而且驗證時間過長。本文介紹開放式設計和驗證語言SystemC，通過該語言可實現(xiàn)RTL測試平臺的復用，降低驗證
  • 關鍵字： RTL  測試平臺  模型    

Cadence推出新一代Encounter RTL-to-GDSII流程

  • 全球電子設計創(chuàng)新領先企業(yè)Cadence設計系統(tǒng)公司(NASDAQ: CDNS)，日前宣布推出最新版Cadence? Encounter? RTL-to-GDSII流程，面向高性能千兆級設計，包括在20納米最新技術節(jié)點上的新設計。這種最新的RTL-to-GDSII設計、實現(xiàn)與簽收流程是與領先的IP與晶圓廠合作伙伴及客戶合作開發(fā)的，能更有效地進行SoC開發(fā)，滿足并超越當今市場所需的功耗、性能與面積需求。
  • 關鍵字： Cadence  RTL-to-GDSII  

基于RTL綜合策略的狀態(tài)機優(yōu)化方案

  • 　有限狀態(tài)機及其設計技術是數(shù)字系統(tǒng)設計中的重要組成部分，是實現(xiàn)高效率、高可靠性邏輯控制的重要途徑。大部分數(shù)字系統(tǒng)都可以劃分為控制單元和數(shù)據(jù)單元兩個組成部分。通常，控制單元的主體是一個狀態(tài)機，它接收外部
  • 關鍵字： RTL  策略  方案    

在FPGA設計中使用Precision RTL 綜合實例

  • 在FPGA設計中使用Precision RTL 綜合實例,數(shù)字濾波器通常分成有限脈沖響應（finite impulse response，也就是FIR）和
    無限脈沖響應（infinite impulse response，也就是IIR）兩大類。FIR 濾波器相對
    于IIR濾波器而言，優(yōu)點是相位線性和性能穩(wěn)定，應用范圍廣
  • 關鍵字： 綜合  實例  RTL  Precision  設計  使用  FPGA  

Synopsys綜合和布局及布線生產效率提升兩倍

  • 　　Synopsys日前宣布，在其Galaxy設計實現(xiàn)平臺中推出了最新的RTL綜合工具Design Compiler 2010，它將綜合和物理層實現(xiàn)流程增速了兩倍。Design Compiler自1988年問世以來，隨著工藝技術從1.5微米到32納米的進步，而不斷得到調整升級。而今時序與面積布線的優(yōu)化已成為主要的挑戰(zhàn)，最新版工具與時俱進，針對拓撲技術進行擴展，為Synopsys布局布線解決方案IC Compiler提供“物理層指引”;將時序和面積的一致性提升至5%的同時，還將IC
  • 關鍵字： Synopsys  RTL  32納米  

Design Compiler 2010將綜合和布局及布線的生產效率提高2倍

  • 　　全球領先的半導體設計、驗證和制造的軟件及知識產權(IP)供應商新思科技有限公司日前宣布：該公司在其Galaxy™設計實現(xiàn)平臺中推出了最新的創(chuàng)新RTL綜合工具Design Compiler 2010，它將綜合和物理層實現(xiàn)流程增速了兩倍。為了滿足日益復雜的設計中極具挑戰(zhàn)性的進度要求，工程師們需要一種RTL綜合解決方案，使他們盡量減少重復工作并加速物理實現(xiàn)進程。為了應對這些挑戰(zhàn)，Design Compiler 2010對拓撲技術進行擴展，為Synopsys旗艦布局布線解決方案IC Compile
  • 關鍵字： Synopsys  Galaxy  RTL  

中芯國際和新思科技攜手推出Reference Flow 4.0

  • 　　全球領先的半導體設計、驗證和制造軟件及知識產權(IP)供應商新思科技公司與中國內地最大的芯片代工企業(yè)中芯國際集成電路制造有限公司日前宣布，將攜手推出全新的65納米RTL-to-GDSII參考設計流程4.0(Reference Flow 4.0)。作為新思科技專業(yè)化服務部與中芯國際共同開發(fā)的成果，該參考流程中增加了 Synopsys Eclypse™ 低功耗解決方案及IC Compiler Zroute布線技術，為設計人員解決更精細工藝節(jié)點中遇到的低功耗和可制造性設計(DFM)等問題提供更多
  • 關鍵字： 中芯國際  65納米  Galaxy  RTL-to-GDSII參考設計流程4.0  

利用現(xiàn)成FPGA開發(fā)板進行ASIC原型開發(fā)

  • 2004年12月在一項由Synplicity公司委托的調查中，全世界超過20,000名開發(fā)者被詢問關于他們的硬件輔助ASIC驗證...
  • 關鍵字： FPGA  ASIC  NRE  RTL  

Magma　最新版Talus Design面世

  • 　　美國加州圣荷塞 2009年4月14日– 芯片設計解決方案供應商微捷碼（Magma®）設計自動化有限公司（納斯達克代碼：LAVA）日前宣布，該公司面向先進集成電路的全芯片綜合產品Talus® Design的最新版本正式面市。新版Talus® Design包括了一個增強的時序優(yōu)化引擎、改善的內存使用效率以及先進的生產率改進，比如：創(chuàng)新性可用性、更為靈活的先進腳本語言以及領先的第三方可測性設計（DFT）產品支持。同時，Talus Design與Talus Vortex相結
  • 關鍵字： Magma  RTL  DFT  Talus  

采用高級節(jié)點ICs實現(xiàn)從概念到推向消費者的最快途徑(08-100)

  • 　　在一個依靠消費者對更精密產品的需求越來越高的市場里，半導體公司正在迅速地向45納米、以及更小的高級工藝節(jié)點發(fā)展。這些技術帶來了芯片質量和性能的大大提升，在系統(tǒng)級芯片上實現(xiàn)了更高級的復雜應用功能整合程度。然而，隨著更多的設計進化到高級技術，半導體公司面臨的設計挑戰(zhàn)也在激增，無法確保迅速量產的風險也在提高。
  • 關鍵字： Cadence  ICs  GDSII  
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