摘 要：本文介紹了IP核的概念及其在SoC設計中的應用，討論了為提高IP核的復用能力而采用的IP核與系統的接口技術。 關鍵詞：SoC；IP核；OCP引言隨著半導體技術的發展,深亞微米工藝加工技術允許開發上百萬門級的單芯片，已能夠將系統級設計集成到單個芯片中即實現片上系統SoC。IP核的復用是SoC設計的關鍵，但困難在于缺乏IP核與系統的接口標準，因此，開發統一的IP核接口標準對提高IP核的復用意義重大。本文簡單介紹IP核概念，然后從接口標準的角度討論在SoC設計中提高I
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IP核 OCP SoC SoC ASIC
中國每三年舉辦一次的固態和集成電路技術國際會議(International Conference on Solid-State and Integrated-Circuit Technology，ICSICT)是目前在中國召開的集成電路和微電子技術領域最高級別和最大的國際會議。它提供了一個展示固態和集成電路領域最新發展的國際交流平臺，為提高中國集成電路技術的學術水平和推動中國集成電路產業的發展起到了十分積極的作用。固態器件、集成電路、工藝技術、先進材料和其它相關的所有研究領域都屬于會議的討論范圍。&nbs
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Cadence SoC ASIC
嵌入式標準產品（ESPs）的先驅企業QuickLogic公司（Nasdaq股票代碼: QUIK）于今天日發布了QL92xxx 系列可編程片上系統器件（ProgrammableSOC）的。該系列產品系列以廣受歡迎的以QuickMIPS 產品系列中的的QL902M為 為基礎并，內置了了專為用于嵌入式數字媒體應用的器件而設計的附加預編程模塊。該系列的首款產品為QL92010，其中內置了了一個IDE控制器。秉承QuickLogic一貫專注努力于提供有線/無線IP網絡數字媒體傳輸和處理的芯片解決方案的傳統，Quic
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QuickLogic SoC ASIC
2004年6月A版
摘 要：本文分析了深亞微米下超大規模SoC的電源設計中存在的問題，給出了業界適用的設計、驗證方法，并以工程設計為例，給出層次性SoC設計中電源設計、驗證的適用流程。
關鍵詞：系統芯片；電源電壓降；地電壓反彈；電源網格
引言
SoC(系統芯片)是現代微電子技術向前發展的必然趨勢。與工藝技術逐步先進的變化相適應，SoC芯片上的內核邏輯的供電電壓也逐步降低。供電電源電壓減小的一個顯著好處是使整個芯片的功耗降低，然而它同時也帶來了芯片噪聲容限降低的負面影響。芯片供電電源
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SoC SoC ASIC
電子設計應用2004年第9期 門陣列的好處在于它不僅可以減小PCB板的尺寸，而且可以降低功耗、提高可靠性，以及降低整個系統成本。但由于門陣列的設計工具價格太高， 流片費用(NRE)的負擔太重，風險高，設計周期太長， 所以不能被一般公司所采用。Xilinx開發出的第一批基于SRAM的FPGA， 由于其軟件價格很低，沒有流片費用，所以它比門陣列更容易普及而被工程師所采用。如今芯片產業已經可以把數百萬門的邏輯放入一個芯片里，使其達到可以把整個系統濃縮到單個芯片的程度，這不僅代表把邏輯和ASIC 放入單一芯片，它
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FPSLIC SoC ASIC
賽普拉斯半導體公司 (NYSE：CY) 的子公司賽普拉斯微系統有限公司（Cypress MicroSystems）于今日宣布已開始生產一款新型可編程系統級芯片（PSoCTM）混合信號陣列。這種具有擴展數字集成功能的新型器件拓展了廣受歡迎的PSoC架構的適用范圍，以滿足消費類、工業、辦公自動化、電信和汽車應用中更大規模、更復雜的嵌入式控制功能的需要。賽普拉斯微系統公司的市場副總裁John McDonald說：“我們注意到客戶需要更多的數字功能，以提高外圍部件的集成度。我們的新款PSoC器件使得可用于實現片上
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賽普拉斯 SoC ASIC
日前，Mentor和華為共同宣布共同建立SOC軟硬件協同驗證環境。旨在加強SoC驗證方面雙方的全面合作。事先，華為已經利用Mentor公司提供的Seamless軟硬件協同驗證方案成功建立了ARM-based SoC驗證環境。利用Seamless協同驗證環境，華為已經成功調試，并解決了多款基于ARM7TDMI、 ARM926ejs、Power PC的SoC芯片軟硬件接口問題。華為早在上個世紀90年代就認識到SoC的功能驗證比傳統的ASIC的功能驗證更具有挑戰性，需要付出更多的仿真努力，同時產品的開發周期也更
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Mentor Graphics SoC ASIC
美國Cadence設計系統公司公司（紐約證券交易所代碼：CDN）董事會主席Ray Bingham先生一行，到北京集成電路設計園訪問, 設計園公司總經理郝偉亞先生詳細介紹了設計園以及北京集成電路設計產業發展情況。Ray Bingham先生表示，Cadence長期致力于中國電子產業的發展，支持北京集成電路產業的發展，對于作為中國7個國家IC設計基地之一的北京集成電路設計園，擴展其數字設計平臺，選用Cadence SoC Encounter為實現很復雜、高性能的芯片提供經過驗證的設計工具，應對納米技術挑戰，感
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Cadence SoC ASIC
美國Cygnal公司專門從事混合信號系統芯片(SoC)單片機的設計與制造。公司更新了原51單片機結構，設計了具有自主產權的CIP-51內核，運行速度高達每秒25MIPS。現已設計并為市場提供了29個品種的C8051F系列SoC單片機，預計今年年內還將完成20多個新的SoC單片機的設計。 C8051F系列是集成的混合信號系統芯片SoC單片機，具有與MCS-51內核及指令集完全兼容的微控制器，除了具有標準8051的數字外設部件之外，片內還集成了數據采集和控制系統中常用的模擬部件和其它數字外設及功能部件(參見圖
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SoC ASIC
半導體器件定標(scaling)在量上的不斷進展蘊育著系統級芯片(SoC)器件在設計和結構上質的深刻變化。IC器件定標可以加強功率效率、增加帶寬和顯著改進功能集成性，而要挖掘出硅的全部性能潛力，還須在設計復雜性管理和改進設計可重用性方面做同樣的努力。代表ITRS對半導體定標的一致觀點的一個簡易技術模型示出了芯片設計上一系列重大變化。較高層次的可編程性可以緩解經濟上的壓力。專用處理器性能的不斷提高和器件的自動生成將使處理器芯核在SoC結構體系中發揮重大作用，諸如從高性能控制到以前只能由硬連接邏輯才可以實現的
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SoC SoC ASIC
賽普拉斯半導體(Cypress Semiconductor)公司的子公司賽普拉斯微系統有限公司（Cypress MicroSystems）于今日宣布推出用于其可編程系統級芯片（PSOCTM）混合信號陣列的PSoC Designer 4.0集成開發環境（IDE）。PSoC Designer 4.0是一個完整的圖形成套工具，它通過提供“點擊”系統設計能力而為用戶利用PSoC的功能和靈活性給予了幫助。PSoC Designer 4.0提供了設備和應用程序編輯器以及一個簡單圖形用戶接口（GUI）下的編譯器、調試器
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賽普拉斯 SoC ASIC
來自美國加州弗雷蒙特市的消息--日月光測試有限公司（納斯達克股票代碼：ASTSF）業界最大的獨立半導體測試服務供應商定購了22臺科利登的SoC 測試系統，包括多臺高性能的Octet，用于計算機芯片組和圖形器件的高量產生產測試。日月光之所以選用該系統是基于其成熟的成本效益高的系統性能和測試能力，可以滿足下一代器件技術，如高速總線系統，不斷增長的對測試系統測試容量和范圍的要求。日月光美國、歐洲兼日本區總裁Tien Wu說：“科利登的SoC測試系統提供給我們客戶可持續的產品面市和成本優勢。Octet與科利登Qu
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科利登 SoC ASIC
全球領先的跨國高科技公司安捷倫科技(NYSE: A)與北京大學微電子學研究院（IMEPKU）今天共同宣布成立北京大學—安捷倫科技SOC測試教育中心和北京大學—安捷倫科技SOC測試工程中心。北京大學—安捷倫科技SOC測試教育中心是華北地區首家SOC測試教育中心，將加速北京大學乃至中國半導體測試技術的研究和發展。同時，北京大學—安捷倫科技SOC測試教育和工程中心也將與業界開展廣泛的合作，致力于推動中國半導體產業的發展。這項合作是知名高校與跨國高科技企業合作的成功典范，對國家“十五”發展計劃提供進一步的有力支持
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安捷倫 SoC ASIC
近年來，隨著多媒體信息應用日益普及，市場對多媒體芯片的需求逐漸增加，韓國ADChips公司適時推出了一款內嵌32位微處理器的多媒體芯片Virgine G2，它集視頻、音頻處理為一身，內部包括了一個基于3維圖形算法的2維圖形加速器，還嵌入了一個32通道的8/16位音頻引擎，以及視頻DAC、DRAM控制器、DMA、定時器、雙串口等多種外設，使得外部電路的設計變得非常簡便。芯片的結構芯片的結構如圖1所示，主要由CPU、2D圖象加速器、音頻引擎及周邊外設組成。32位微處理器EISC SE3208Virgine G
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SOC SoC ASIC
2002年11月13日，領先的可編程邏輯器件(PLD)供應商賽靈思公司(Xilinx)宣布，在深圳成立新的辦事處，以更好地滿足中國市場對其PLD產品的需求。
由于PLD新興應用領域的迅速拓展、中國本土新興企業的增多、跨國公司研發機構向中國的轉移以及來自傳統客戶的穩定營收，中國已經成為Xilinx公司最重要的新興市場。“為滿足現有的PLD應用以及非傳統PLD應用的需要，也為了更好地為我們現有及潛在客戶提供服務，Xilinx公司在深圳市開設了辦事處。” Xilinx公司總裁兼
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Xilinx 半導體 ASIC
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