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EEPW首頁(yè) >> 主題列表 >> 交織器

用FPGA實(shí)現(xiàn)TETRA數(shù)字集群通信系統(tǒng)語(yǔ)音信道編碼中的交織器

  • 交織技術(shù)能很好地糾正信息傳輸過(guò)程中出現(xiàn)的突發(fā)性錯(cuò)誤。在數(shù)字信息傳輸系統(tǒng)中得到了廣泛應(yīng)用。本文將在討論信息產(chǎn)業(yè)部重點(diǎn)支持發(fā)展的TETRA數(shù)字集群通信系統(tǒng)語(yǔ)音信道編碼結(jié)構(gòu)和流程的基礎(chǔ)上，重點(diǎn)研究交織技術(shù)在其語(yǔ)音信道編碼中的應(yīng)用及用FPGA實(shí)現(xiàn)該交織器的方法。
  • 關(guān)鍵字： TETRA  數(shù)字集群  FPGA  通信系統(tǒng)  語(yǔ)音信道編碼  交織器  

一種基于FPGA的TD-SCDMA塊矩形交織器的設(shè)計(jì)與實(shí)現(xiàn)

  • 基于TD-SCDMA系統(tǒng)的特點(diǎn)和交織原理提出一種交織器電路的設(shè)計(jì)思路,進(jìn)行了相關(guān)數(shù)據(jù)的分析,在QuartusⅡ8.0軟件平臺(tái)上,用verilog語(yǔ)言進(jìn)行了實(shí)現(xiàn),并對(duì)其進(jìn)行了編譯、功能仿真和時(shí)序仿真。用QuartusⅡ8.0軟件生成RTL門(mén)級(jí)電路,將實(shí)際生成電路與理論設(shè)計(jì)電路進(jìn)行比較,并配置到可編程邏輯器件EP1K30TC144-3進(jìn)行驗(yàn)證,測(cè)試結(jié)果表明本設(shè)計(jì)的正確性與有效性。
  • 關(guān)鍵字： TD-SCDMA  交織器  RTL門(mén)級(jí)電路  

利用FPGA技術(shù)實(shí)現(xiàn)數(shù)字通信中的交織器和解交織器

  • 介紹用FPGA實(shí)現(xiàn)數(shù)字通信中的交、解交織器的一種比較通用的方案，詳細(xì)說(shuō)明了設(shè)計(jì)中的一些問(wèn)題及解決辦法。還介紹了一種實(shí)現(xiàn)FPGA中信號(hào)延時(shí)的方法。
  • 關(guān)鍵字： 數(shù)字通信  交織器  FPGA  信號(hào)延時(shí)  

一種交織器和解交織器的FPGA電路實(shí)現(xiàn)

  • 交織和解交織是組合信道糾錯(cuò)系統(tǒng)的一個(gè)重要環(huán)節(jié)，交織器和解交織器的實(shí)現(xiàn)方法有多種。本文利用Altera公司開(kāi)發(fā)的Quartus軟件平臺(tái)和仿真環(huán)境，設(shè)計(jì)一種交織器和解交織器FPGA電路單倍實(shí)現(xiàn)的方法，并分析該電路實(shí)現(xiàn)的特點(diǎn)
  • 關(guān)鍵字： FPGA  交織器  電路實(shí)現(xiàn)    

基于FPGA的改進(jìn)型分組交織器的設(shè)計(jì)與實(shí)現(xiàn)

  • Turbo碼是由法國(guó)人Berrou于1993年提出的一種性能優(yōu)越的信道編碼方案[1]，其應(yīng)用已逐步推廣到衛(wèi)星通信、移動(dòng)通信和計(jì)算機(jī)通信等領(lǐng)域。交織器作為T(mén)urbo碼編碼器中的重要組成部分，在Turbo碼的性能中起著至關(guān)重要
  • 關(guān)鍵字： FPGA  改進(jìn)型  分組  交織器    
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交織器介紹

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